Xilinx Vivado工具支持仅将系统设计的一部分進行综合即OOC（out of context）综合方式。OOC综合方式的流程就是将设计的某个模块单独完成综合操作这会带来如下可能性：

通过综合实现这个模块的赽速迭代，不用综合系统的其余部分整个设计的迭代也更快了

利于系统其余部分的快速迭代如果某部分确定稳定不变了，可以对这个模塊进行OOC综合操作保留这个综合版本，这样就可以方便迭代其余部分

某个模块的改变只需要再对此模块进行综合即可节省的时间用于模塊功能设计

OOC综合方式非常适合IP核的设计，我们可以将自己的IP核采用OOC方式进行综合然后使用综合后的输出结果

这意味着当我们使用IP核时我们鈈需要在进行IP核的综合操作就可以完善系统设计

然而如果设计中存在三态（高阻态），OOC综合操作就会受到影响

FPGA仅支持I/O输出端口的高阻态在器件内部是不允许的

如果你使用OOC综合方式，Vivado工具并不知道某个具体的信号是连接I/O输出还是在器件内部进行连接

最后综合工具会将这個高阻信号转换为某个逻辑值，而不是最为高阻态进行综合

通过OOC方式综合后my_signal信号值就不会是高阻值Z了

Vivado综合有两个选择：
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